Usando um conjunto de redes latch/reset, torna-se possível permitir que uma lógica se mova em uma seqüência direta, ligando um determinado conjunto de saídas em ALTO, em resposta a um clock de entrada alternado. E uma vez atingido o limite máximo, os relógios de entrada começam a desligar ou retirar a sequência na ordem oposta.
Assim, a sequência up down é controlada através de um único sinal de clock de entrada oscilante.
O processo também pode ser explicado da seguinte forma:
Em resposta a um clock de comutação aplicado, o circuito começa a adicionar lógicas HIGH nas saídas em uma sequência de incremento e, uma vez atingido o limite máximo, ele começa a subtrair o HIGH da saída tornando-os LOW na sequência oposta, em resposta ao valor aplicado. sinais de relógio.
Aqui apenas 4 saídas são mostradas, uma vez que o IC 4043 tem apenas 4 pares de travas set/reset, no entanto, o número pode ser aumentado pela cascata do IC 4017 e pela adição de outro IC 4043 com o existente. Isso nos permitiria obter 8 números de sequenciamento set/reset ou 8 pares de saídas para cima/para baixo.
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Este circuito pode ser muito útil para controlar um determinado parâmetro, de modo que qualquer aumento adicional do parâmetro seja inibido assim que o limite máximo for excedido e, inversamente, o processo será restaurado e iniciado quando o limite voltar à faixa.
Por exemplo, pode ser aplicado em elevadores pequenos para permitir que apenas 3 pessoas entrem no elevador, uma vez que este limite excede, o elevador é inibido de iniciar, mas uma vez que o limite é restabelecido o elevador pode se mover.
Como funciona este sequenciador UP/DOWN
Este circuito foi originalmente criado para iniciar as fontes de alimentação em sequência e posteriormente desligá-las pela segunda vez na sequência oposta. Esse recurso pode ser útil para mexer em equipamentos e circuitos onde a energia precisa ser empregada e retirada em uma ordem específica.
A seção principal do circuito é o contador de décadas IC 4017 CMOS do cavalo de trabalho. As saídas Q1 a Q4 estão acostumadas a estabelecer travas em série na ordem de 1-2-3-4, após o que a contagem é interrompida. Pressionar a chave S1 permite que a contagem continue, e agora as saídas do contador Q5 a Q8 são aplicadas para reinicializar as travas na sequência oposta, ou seja, na ordem 4-3-2-1. A última saída, Q9, é utilizada para parar o contador.
Assim que a energia é ligada, C2 e R2 primeiro tornam o contador na posição de reinicialização. Uma vez que a tensão da fonte de alimentação se torna estável, o sinal de reset eventualmente fica baixo, permitindo que o 4017 inicie a contagem no sinal de clock de 1 Hz que é adquirido através de um oscilador composto por IC1d, R3 e C3.
Os pinos de saída do IC 4017 são acionados sucessivamente com cada borda de subida do pulso de clock. No entanto, quando o pulso de clock seguinte chega, a última saída é desligada.
As travas no quad RS-latch tipo 4043 permitem que as saídas permaneçam ativadas. IC2 para de contar em Q4 por causa de IC1b que remove o sinal de habilitação de clock no pino 13 através de IC1a.
Para permitir que o 4017 continue contando e, portanto, desligue as saídas, é necessário pressionar S1, o que restabelece o clock-enable no pino 13.
As saídas do contador Q5 a Q8 são conectadas às entradas de reset das travas, de modo que a sequência IC2 se move para baixo, as travas são reiniciadas na direção reversa. O processo de contagem é eventualmente interrompido em Q9 pelo IC lc, que mais uma vez retira o sinal de habilitação do relógio.
Resistores de pull-up de alto valor e baixa corrente (R4-R7) são empregados nas entradas de ‘reset’ da trava para evitar situações de partida indefinidas.
Lista de peças
Resistores (todos os resistores são 1/4 watt 5%)
R1 = 4K7
R3 = 4M7
R2, R4, R5, R6, R7 = 1M
Capacitores
C1, C4, C5 = 0,1uF/cerâmica
C2 = 22uF/25V
C3 = 1uF/25V
Circuitos integrados
IC 4017 = 1 não
IC 4043 = 1 não
IC 4093 = 1 não
S1 = pressione o interruptor ON
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FONTE
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